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香港城市大学 · 课程

EE2000逻辑电路设计

Logic Circuit Design

2026/27 · 本科

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课程代码
EE2000
学分
3
教学单位
电机工程学系
可阅学习资料
185 份

课程介绍与修读要求

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2026/27 · 官方课程目录版本

该 PDF 文件注明的生效学期为 Semester A 2025/26。

2026/27 开课安排尚未核对。选课前请在 AIMS 确认可选课节。

这门课学什么

港真课程概览

从布尔代数和逻辑函数简化开始，进而设计组合及序列电路，并接触功能模块与硬件实现概念。

课程概述与目标
The aim is to provide students with an understanding of the concepts and design of logic circuits, including (i) various devices, techniques for analyzing and designing combinational circuits and sequential circuits, circuit design and implementation techniques, and (ii) Hardware Description Language (HDL) modelling and synthesis of combinational and synchronous sequential circuit, circuit implementation with FPGA devices. The electrical characteristics of selected logic families are also covered.
教学内容（Keyword Syllabus）
Revision of Boolean algebra Boolean algebra and switching functions; minterm and maxterm canonical forms; sum of products and products of sums; don’t care conditions; minimization of Boolean algebra. Combinational Logic Circuit Design Minimization by Karnaugh map and Quine-McCluskey method; circuit designs; timing parameters and circuit hazards. Circuit Design with Functional Blocks Carry Look Ahead adder; comparators; decoders and encoders; multiplexers and demultiplexers. Introduction to Hardware Description Language (HDL) Introduction to Hardware Description Language (HDL); logic gates and combinational circuit modelling. Flip-flops Latches, RS, JK, D-type, edge-triggered and master-slave flip-flops; triggering and setting; timing parameters; HDL circuit modelling. Synchronous Sequential Logic Circuit Design Concept of states; Mealy and Moore Machines; redundant state elimination; sequential digital system analysis and design; HDL sequential circuit modelling. Registers and Counter Basic registers and counters; ripple counters and synchronous counters, and their applications; construction of registers and counters; HDL circuit modelling. Field-Programmable Gate Array Introduction to Look-up Table (LUT), Generic Array Logic (GAL), Programmable Array logic (PAL), simple programmable logic device, complex programmable logic device (CPLD), Field-Programmable Gate Array (FPGA), Programmable System- on-Chip (SoC). FPGA Implementation Combination and synchronous sequential circuit synthesis; datapath component description, debugging and validation. Logic Families Introduction to electrical characteristics of TTL and CMOS logic families; transfer characteristics, noise margins; fan-in and fan-out; comparison of families; interfacing between different families.

校方 PDF 第 4–5 页 · Keyword Syllabus

预期学习成果
查看学习成果表
CILO预期学习成果比重DEC
1Apply different methods to simplify combinational logic functions and sequential machines—DEC-A2
2Analyze and design combinational and synchronous sequential circuits—DEC-A1, DEC-A2
3Identify electrical characteristics of different logic families—DEC-A1, DEC-A2
4Design logic circuit using VHDL Hardware Description Language—DEC-A1, DEC-A2
5Implement logic circuits with Xilinx FPGA—DEC-A1, DEC-A2
6Apply basic theories to practical work—DEC-A1, DEC-A2

校方 PDF 第 2 页 · Course Intended Learning Outcomes (CILOs)

我能不能修这门课

先修、建议先备和并修要求分别查看；等同及互斥条件也会影响选课。and 表示同时满足，or 表示备选；组合条件按下方原文分组阅读。

先修条件
EE1001 Foundations of Digital Techniques (only applicable to EE students) or EE1002 Principles of Electrical Engineering (only applicable to ITME students)
建议先备知识
无（校方注明 Nil）
并修要求
该版官方课纲未列明该项。
其他修读要求
该版官方课纲未列明该项。
等同课程及条件
无（校方注明 Nil）
互斥课程及条件
无（校方注明 Nil）

怎么考，怎样才算通过

考核方式
Continuous assessment: 50%; Examination: 50%; Examination duration: 2 hours

各项考核占多少分

考核项目比重生成式 AI 使用备注与限制
TestsCILO 1, 2, 3, 4, 625%否（No）-
AssignmentsCILO 1, 2, 3, 4, 610%是（Yes）-
Lab Exercises/ReportsCILO 1, 2, 3, 4, 5, 615%是（Yes）-

校方 PDF 第 3 页 · Assessment Tasks / Activities (ATs)

查看校方原始考核表与使用要求
Assessment Tasks / Activities (ATs)
                        ATs               CILO No.              Weighting (%)               Remarks ("-" for   Allow Use of
                                                                                            nil entry)         GenAI?
1                       Tests (min.: 2)   1, 2, 3, 4, 6         25                          -                  No
2                       #Assignments      1, 2, 3, 4, 6         10                          -                  Yes
                        (min.: 3)
3                       Lab Exercises/    1, 2, 3, 4, 5, 6      15                          -                  Yes
                        Reports
通过条件
Remark: To pass the course, students are required to achieve at least 30% in course work and 30% in the examination. Also, 75% laboratory attendance rate must be obtained. # may include homework, tutorial exercise, project/mini-project, presentation
学分、时长与版本信息
本版本课程名称
Logic Circuit Design
本版本学分
3
修读时长
One Semester
课纲生效学期
Semester A 2025/26
课纲列明的级别
B1, B2, B3, B4 - Bachelor's Degree

核对官方原文件

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来源 · 校方课程介绍 ↗ · 查阅 2026-10-18

课程资料

185 份可阅资料

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40 / 185 份

  • EE 2000_ Tut 01

    习题 · 2021-2022 Semester A · 本机审阅资料 · 468 KB

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  • EE 2000_ Tut 01__内容不同_445796730f

    习题 · 2021-2022 Semester A · 本机审阅资料 · 132 KB

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  • EE 2000_ Tut 01_solution

    习题 · 2021-2022 Semester A · 本机审阅资料 · 213 KB

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  • EE 2000_ Tut 01_solution

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  • EE 2000_ Tut 02__内容不同_a53fc17658

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  • EE 2000_ Tut 02_solution

    习题 · 2021-2022 Semester A · 本机审阅资料 · 567 KB

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  • EE 2000_ Tut 03

    习题 · 2021-2022 Semester A · 本机审阅资料 · 276 KB

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  • EE 2000_ Tut 03__内容不同_d6c5daa79d

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  • EE 2000_ Tut 03_solution

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  • EE 2000_ Tut 03_solution

    习题 · 2021-2022 Semester A · 本机审阅资料 · 448 KB

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  • EE 2000_ Tut 04

    习题 · 2021-2022 Semester A · 本机审阅资料 · 70 KB

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  • EE 2000_ Tut 04__内容不同_32a9a7ebef

    习题 · 2021-2022 Semester A · 本机审阅资料 · 76 KB

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  • EE 2000_ Tut 04_solution

    习题 · 2021-2022 Semester A · 本机审阅资料 · 264 KB

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  • EE 2000_ Tut 04_solution

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  • EE 2000_ Tut 05

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  • EE 2000_ Tut 05__内容不同_41d3054a74

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  • EE 2000_ Tut 05_solution

    习题 · 2021-2022 Semester A · 本机审阅资料 · 73 KB

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  • EE 2000_ Tut 06

    习题 · 2021-2022 Semester A · 本机审阅资料 · 20 KB

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  • EE 2000_ Tut 06_Solution

    习题 · 2021-2022 Semester A · 本机审阅资料 · 296 KB

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  • EE 2000_ Tut 07

    习题 · 2021-2022 Semester A · 本机审阅资料 · 326 KB

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  • EE 2000_ Tut 07_Solution

    习题 · 2021-2022 Semester A · 本机审阅资料 · 392 KB

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  • EE 2000_ Tut 08

    习题 · 2021-2022 Semester A · 本机审阅资料 · 112 KB

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  • EE 2000_ Tut 08_Hints

    习题 · 2021-2022 Semester A · 本机审阅资料 · 74 KB

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  • EE 2000_ Tut 09

    习题 · 2021-2022 Semester A · 本机审阅资料 · 463 KB

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  • EE 2000_ Tut 09_Hints

    习题 · 2021-2022 Semester A · 本机审阅资料 · 1.1 MB

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  • EE 2000_ Tut 10

    习题 · 2021-2022 Semester A · 本机审阅资料 · 36 KB

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  • Assignment1_2021A

    作业 · 2020-2021 学期不明 （年份沿用原文件夹标注） · 本机审阅资料 · 121 KB

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  • EE 2000_ Lecture 01__内容不同_23603124c2

    课件 · 2020-2021 学期不明 （年份沿用原文件夹标注） · 本机审阅资料 · 831 KB

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  • EE 2000_ Lecture 02

    课件 · 2020-2021 学期不明 （年份沿用原文件夹标注） · 本机审阅资料 · 2.6 MB

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  • EE 2000_ Lecture 03

    课件 · 2020-2021 学期不明 （年份沿用原文件夹标注） · 本机审阅资料 · 1.1 MB

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  • EE 2000_ Lecture 04__内容不同_7249a19754

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  • EE 2000_ Lecture 05__内容不同_d7bbbb1592

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  • EE 2000_ Lecture 06__内容不同_0129b76e25

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  • EE 2000_ Lecture 07__内容不同_7b724cddc3

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  • EE 2000_ Lecture 08__内容不同_70d986266d

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  • EE 2000_ Lecture 09__内容不同_b41d6932e0

    课件 · 2020-2021 学期不明 （年份沿用原文件夹标注） · 本机审阅资料 · 1.6 MB

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  • EE 2000_ Lecture 10__内容不同_0365af6afa

    课件 · 2020-2021 学期不明 （年份沿用原文件夹标注） · 本机审阅资料 · 2.3 MB

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  • EE 2000_ Tut 06__内容不同_c3df50a8e1

    习题 · 2020-2021 Semester A （年份沿用原文件夹标注） · 本机审阅资料 · 121 KB

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  • EE 2000_ Tut 07__内容不同_dd10cd0815

    习题 · 2020-2021 Semester A （年份沿用原文件夹标注） · 本机审阅资料 · 198 KB

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  • EE 2000_ Tut 08__内容不同_f7ed36c445

    习题 · 2020-2021 Semester A （年份沿用原文件夹标注） · 本机审阅资料 · 89 KB

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在哪些专业培养计划里

准备选这门课，接下来怎么做

  1. 核对学年与修读条件

    使用本页对应学年的介绍，逐项确认先修、并修及互斥条件。尚缺关键条件时，先通过本页校方来源核实。

  2. 对照自己的专业培养计划

    确认这门课计入哪类要求，以及是否需要在同组选课中二选一或选满指定学分。

  3. 到 AIMS 查看课节并确认选课结果

    查看当期实际可选课节、名额和时间。按选课流程提交后，再核对课程与课节是否成功加入；目录中的课程记录本身不代表已完成选课。

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